晶振導(dǎo)讀：一般來說，大公司對硬件電路的設(shè)計很少，這是從長期經(jīng)驗中總結(jié)出來的，以減少重復(fù)勞動，確保產(chǎn)品質(zhì)量。圖紙基本上是直接從模塊電路中復(fù)制出來的，審查人員也按照標準電路進行檢查，這樣他們就不必每次都考慮如何設(shè)計。
您提到的晶體輸出串聯(lián)電阻來自較小化設(shè)計。對于數(shù)字電路中較重要的時鐘源部分，應(yīng)特別注意保證信號的完整性。在極小化設(shè)計中，除電阻外，晶體外圍電路中還有其它器件。
串聯(lián)電阻用于減小反射波，避免反射波疊加引起的過沖。有時，不同批次的板具有不同的特性，留下一個電阻位置來調(diào)整板的狀態(tài)到較佳。如果不需要串聯(lián)電阻，則使用0歐姆電阻進行連接。反射在大多數(shù)電路中都是有害的，但PCI使用反射來產(chǎn)生有效的信號。
1、減少諧波，方波是有源晶體的輸出，它會引起諧波干擾，特別是當阻抗嚴重失配時。當阻抗增加時，電阻與輸入電容形成RC積分平滑電路，將方波轉(zhuǎn)換成近似正弦波。雖然信號的完整性在一定程度上受到了影響，但信號將在以后被放大和整形。作為時鐘信號，性能不受影響。根據(jù)有源晶體的輸入阻抗、輸入等效電容和輸出阻抗選擇電阻。
2、阻抗匹配，以減少回波干擾和信號過沖。我們知道，只要阻抗不匹配，就會有信號反射，即回波。有源晶體的輸出阻抗通常很低，通常低于幾百歐元的交流電。信號源的輸入通常是芯片內(nèi)部結(jié)構(gòu)中運算放大器的輸入。諧振電路由芯片內(nèi)部電路和外部無源石英晶體組成（使用有源晶體后，不需要該晶體）。這個放大器的輸出阻抗高于兆歐。
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